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amiga-news.de Forum > Amiga, AmigaOS 4 > MPC745 auf Cyberstorm oder Blizzard [ - Search - New posts - Register - Login - ]

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2005-10-17, 23:16 h

Eule
Posts: 1607
User
Original von Vigo:


>Ach nee, jetzt echt?

Ja ! Toll ne, das hättest du nicht gedacht ... < wie ich diese scheinheiligen Idiotenfragen hasse ! Manch mal weiß man nicht ob der Frager wirklich so ein Depp ist, als den er sich darstellt.>

>wurde das Design so angelegt, dass alle FlipFlops
>von der Global Clock getaktet werden?

Bei der MK2 wurden ganz bestimmt nicht alle Signale mit dem Global Clock getaktet, IMR ging das bei der Ansteuerung der RAMs gar nicht. Und wenn du das meinst, dann sag es einfach richtig.

Soweit mir bekannt müssen einige Timings kürzer als der Systemtakt sein.

Warscheinlich gilt das auch für die CSPPC

>Juchuuu, wir haben 2005!

Schön das du das auch bemerkt hast, leider stammt das CSPPC Design noch aus dem letzten Jahrtausend.

>Worin ist der CPLD Code geschrieben?

Weiß ich nicht, bei der MK2 wurde noch kein VHDL eingesetzt. Für einige MACHs auf der CV64-3D wurde ein kostenloses Tool von Cypress benutzt und dann wurden die .jed ( o.ä. ) Dateien mit einem selbstgestrickten Tool konvertiert damit man damit MACHs programmieren konnte. Die Tools für die MACHs haben nämlich noch Geld gekostet.

Womit die CSPPC entworfen wurde kann man jetzt nur abschätzen.

>Wenn es eine Standard Sprache wie VHDL ist, brauchst Du etwa genau
>0.00 EUR an Software, um das Design auf andere CPLD's zu portieren
>und zu testen

Ja vielleicht aber vorher musst du jemanden bezahlen der den Kram von irgendwelchen alten Platten im Keller krazt und eine Doku erstellet die entweder verloren ist oder unverständlich wäre.

>Nicht, wenn sie genau so programmiert sind. Sicher, das Pinout
>müsste man ändern,

Das ist eine Designänderung !

Andere Zeiten in den Chips sind eine Designänderung

Andere Chips sind eine Design änderung.

Da gibt kein ja aber da gibts nur ein ohne ordendlich gepflegte Originalunterlagen und jemand der sich in das Projekt einarbeitet wirds nichts.

>Herrgott...

Es reicht wenn du mich Eule nennst.


>Blablablubb, erstens, ich müsste erst einmal den Code haben,
>um überhaupt anfangen zu können.

Höhr auf mit deinem dummen Kindergeblubber, du gibst mir ja bereits recht.

>Zweitens, hat jede CPLD/FPGA Entwicklungsumgebung mittlerweile
>einen kostenlosen und leistungsfähigen Simulator/Debugger on board.

Ach plötzlich widersprichst du mir. Einen Simulator Debugger hatten sie auch und ich habe mitbekommen wie er versagt hat.

>Drittens, wir reden hier nicht vom nächsten C-One Projekt mit
>originalgetreuem Commodore 64 Core,

Ach jetzt gibst du mich schon wieder recht Ich hoffe du weißt noch was du sagen willst. Viele die deine Geschreibsel lesen wissen es bestimmt nicht mehr:

Man könnte etwa so was verstehen: Eigentlich ist es ja unheimlich leicht aber doch unheimlich schwer und dann doch sehr leicht und ich meine ...

[ - Answer - Quote - Direct link - ]
2005-10-17, 23:21 h

Eule
Posts: 1607
User 		@pixl:

>Thomas Rudloff der entwickler hat keine lust mehr etwas für
>den Amiga zu tun weil wie er selbst sagt eine karte wo keine
>Software läuft ( damit meint er wohl das OS4 ) nutzlos ist.

Warscheinlich denkt er eher an MOS, zumindest hatte er früher gute Kontakte zu den Leuten vom MOS Team.

[ - Answer - Quote - Direct link - ]
2005-10-17, 23:35 h

MaikG
Posts: 5172
User 		>1. die absolut sichere mit einem Oszilloskop (100MHz,
>ich habe nur ein 20MHz).

Takte den Bustakt auf 20 MHZ, dann sollte das doch gehen.
Der Max. Bustakt CPPC in Standartausführung ist 66 MHZ.

>2. die nicht so sichere, weil wir uns auf Daten aus
>Datenblättern verlassen, die Verbindungen zwischen 603e
>und den Bustransceivern per Durchgangsprüfer ausmessen
>Die zweite Variante wäre trotzdem nicht schlecht, man
>könnte so einen Teil des Schaltbildes rekonstruieren,
>was aber sehr viel Arbeit macht und einen gewissen
>Unsicherheitsfaktor in sich birgt.

Schaltpläne aus Platinen mit 4 Chips hab ich schon gemacht...

>Die paar Signale vom MPC745, die vom 603e abweichen,
>gehören zum L2 Cache Interface. Da wir einen L2 Cache
>weder auf der Blizzard, noch auf der Cyberstorm haben,
>gehe ich mal davon aus, bzw. hoffe ich, daß diese Signale
>auch nicht weiter von der übrigen Logic auf der Karte
>verwendet/gebraucht werden und somit keine Rolle spielen.

Gehören zum L2 Cache vom 74x oder 60xe ? Die betreffenden
Pins wenn diese von der CPU her NC sein dürfen, müssen
ja auch auf der Turbokarte NC sein. Also unbenutzt sein.

Übrigens komme ich bei der Blizzard an die Prozessorbeine
genauso (schlecht) ran wie bei der CPPC wo soll da der unterschied
sein. Zumindest die 240er Version scheint in der gleichen weise
gelötet zu sein wie der 604e auf der CPPC.

[ - Answer - Quote - Direct link - ]
2005-10-18, 00:15 h

pixl
Posts: 2581
User 		@ylf:
um es klar zu stellen ich halte es für eher wahrscheinlich einen G3 auf eine Blizzard oder Cyberstorm zu löten als mal eben 300 leute zusammenzubekommen und eine Karte neu zu designen, oder Thomas Rudloff zu einer weiterentwicklung seiner Karte zu bewegen.
Konkret die Arbeit an dieser sache überlasse ich anderen , ich kann dier nur schon genante Hardware A4000 Motherboard , Daughterboard von Eagle Netzteil und eine 604/233 CSPcc zur verfügung stellen , bzw jeden anderen der sich mit diesem Projekt befasst.
Somit kannst Du oder andere mal auch die Bedingunge n für die CSPPC ausstesten da ich denke das zwei ziemlich unterschiedliche Entwicklungen sind.




was das andere Projekt angeht so versuche ich mich so realistisch wie möglich zu halten und die Zahlen der interessierten in meinem Forum sprechen da für sich.
Aber abwarten es gibt da einige Leute die voller Elan sind.
Vielicht schaffen wir ja doch das unmögliche.
Oder ihr schafft euer Projekt, was m. E. die einfachste und preiswwerteste variante wäre.



--
http://www.pixlmedia.de/
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mfg Pixl

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2005-10-18, 00:31 h

Vigo
Posts: 1254
[Former member]
Zitat:
Original von Eule:
Ja ! Toll ne, das hättest du nicht gedacht ... < wie ich diese scheinheiligen Idiotenfragen hasse ! Manch mal weiß man nicht ob der Frager wirklich so ein Depp ist, als den er sich darstellt.>

Manche hassen scheinheilige Idiotenfragen, Andere scheinheilige Idiotenantworten...

Zitat:
>wurde das Design so angelegt, dass alle FlipFlops
>von der Global Clock getaktet werden?

Bei der MK2 wurden ganz bestimmt nicht alle Signale mit dem Global Clock getaktet, IMR ging das bei der Ansteuerung der RAMs gar nicht. Und wenn du das meinst, dann sag es einfach richtig.

Soweit mir bekannt müssen einige Timings kürzer als der Systemtakt sein.

Warscheinlich gilt das auch für die CSPPC

Also verwendet das Design bewusst die Gatterlaufzeiten der CPLD's. Das wäre natürlich nicht gut. (würde aber so manche Sachen erklären...)

Zitat:
>Juchuuu, wir haben 2005!

Schön das du das auch bemerkt hast, leider stammt das CSPPC Design noch aus dem letzten Jahrtausend.

Auch bezüglich der Komplexität.

Zitat:
Weiß ich nicht, bei der MK2 wurde noch kein VHDL eingesetzt. Für einige MACHs auf der CV64-3D wurde ein kostenloses Tool von Cypress benutzt und dann wurden die .jed ( o.ä. ) Dateien mit einem selbstgestrickten Tool konvertiert damit man damit MACHs programmieren konnte. Die Tools für die MACHs haben nämlich noch Geld gekostet.

Womit die CSPPC entworfen wurde kann man jetzt nur abschätzen.

Ich vermute mit derselben Methode, da sowohl Cypress als auch Mach Chips verwendet wurden. D.h. wahrscheinlich hat man eine AHDL Variante benutzt.

Zitat:
>Wenn es eine Standard Sprache wie VHDL ist, brauchst Du etwa genau
>0.00 EUR an Software, um das Design auf andere CPLD's zu portieren
>und zu testen

Ja vielleicht aber vorher musst du jemanden bezahlen der den Kram von irgendwelchen alten Platten im Keller krazt und eine Doku erstellet die entweder verloren ist oder unverständlich wäre.

Das Auffinden von alten Dateien zähle ich nicht gerade zu den Entwicklungskosten. Ist ungefähr so relevant wie die Hausputze mit einzuberechnen, die den Staub von den Rechnern erst einmal wegfegen muss.

Eine Doku ist nicht unbedingt wichtig, anhand des Sourcecodes kann man bereits abschätzen, was die einzelenen CPLD's für Funktionen haben.

Zitat:
Das ist eine Designänderung !

Andere Zeiten in den Chips sind eine Designänderung

Andere Chips sind eine Design änderung.

Wenn das Design sauber aufgebaut wurde, ist die Portierung eine minimale Designänderung.

Zitat:
Da gibt kein ja aber da gibts nur ein ohne ordendlich gepflegte Originalunterlagen und jemand der sich in das Projekt einarbeitet wirds nichts.

Habe ich das Gegenteil behauptet? Werden mir wieder Sachen, die ich nicht gesagt habe, in den Mund gelegt? Drücke ich mich so unverständlich aus?

Zitat:
Höhr auf mit deinem dummen Kindergeblubber, du gibst mir ja bereits recht.

Ob Kindergeblubber oder andere Varianten von Geblubber, Geblubber bleibt Geblubber.

Zitat:
Ach plötzlich widersprichst du mir. Einen Simulator Debugger hatten sie auch und ich habe mitbekommen wie er versagt hat.

Schön, hat welche Relevanz für Heute?

Zitat:
Ach jetzt gibst du mich schon wieder recht Ich hoffe du weißt noch was du sagen willst. Viele die deine Geschreibsel lesen wissen es bestimmt nicht mehr:

Man könnte etwa so was verstehen: Eigentlich ist es ja unheimlich leicht aber doch unheimlich schwer und dann doch sehr leicht und ich meine ...

Hör zu, back Dir meinetwegen ein Eis, das bringt uns genausoviel, wie sich Deine äußerst interessanten, aber bezüglich des ursprünglichen Themas leider vollkommen unnützen Ausführungen anzuhören.

Dabei ist es doch sehr, sehr einfach, was ich brauche:

1. Ich bräuchte die Sourcecodes, um anzufangen (habe nie etwas anderes behauptet).
2. Anhand der Sourcecodes kann ich dann abschätzen, ob eine einfache Portierung möglich ist.
3. Es bliebe den anderen Leuten überlassen, das Boardlayout an den neuen Chips anzupassen.

So, da weder Du noch ich die Sourcecodes haben, ist eine weitere Diskussion darüber müßig. Ich persönlich bin der Meinung, dass es möglich ist, die Logik der Blizzard/Cyberstorm auf neuere CPLD's zu übertragen. Ich habe nie behauptet, dass es einfach wird, ich behaupte nur, dass es prinzipiell möglich ist.

--
Jeder User verdient seinen Computer.

[ Dieser Beitrag wurde von Vigo am 18.10.2005 um 01:24 Uhr editiert. ]

[ Dieser Beitrag wurde von Vigo am 18.10.2005 um 01:26 Uhr editiert. ]

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2005-10-18, 09:29 h

Zettmaster
Posts: 722
User
So langsam füllt sich das Forum mit Leben:

G3/G4 Forum

Dort kann weiterdiskutiert werden :)

Wer interesse hat oder Erfahrungen mitbringt, Ideen umsetzen kann und einfach nur begeistert ist oder helfen möchte kann jetzt dabei sein ;)

gruß
enrico
--
µA1 C 750GX 933MHz,512MB Ram,Radeon7000 32MB, LAN (DSL3000+512 Upload),80GB Samsung, DVD-RW & DVD-LW, OS4.0 Upd3 + Diverse andere Software...

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2005-10-18, 16:55 h

ylf
Posts: 4112
User
Zitat:
Original von MaikG:
>1. die absolut sichere mit einem Oszilloskop (100MHz,
>ich habe nur ein 20MHz).

Takte den Bustakt auf 20 MHZ, dann sollte das doch gehen.
Der Max. Bustakt CPPC in Standartausführung ist 66 MHZ.
An diese Möglichkeit habe ich auch schon gedacht. Jedoch ist nicht sichergestellt, das die Karte bei so extremer Untertakung auch läuft. Das muß man einfach probieren. Abgesehen davon habe ich mein Oszilloskop eh nicht hier. Sonst hätte ich das vielleicht schon probiert.



Zitat:
>Die paar Signale vom MPC745, die vom 603e abweichen,
>gehören zum L2 Cache Interface. Da wir einen L2 Cache
>weder auf der Blizzard, noch auf der Cyberstorm haben,
>gehe ich mal davon aus, bzw. hoffe ich, daß diese Signale
>auch nicht weiter von der übrigen Logic auf der Karte
>verwendet/gebraucht werden und somit keine Rolle spielen.

Gehören zum L2 Cache vom 74x oder 60xe ? Die betreffenden
Pins wenn diese von der CPU her NC sein dürfen, müssen
ja auch auf der Turbokarte NC sein. Also unbenutzt sein.
Es geht konkret um die Signale CSE0 und CSE1 vom 603e, die beim MPC745 nicht vorhanden sind. Sind Ausgänge, werden für ein externes Cacheinterface benötigt,(der MPC750/755 hat dies bereits integriert und deshalb ein 360pin Gehäuse) können also offen bleiben.



Zitat:
Übrigens komme ich bei der Blizzard an die Prozessorbeine
genauso (schlecht) ran wie bei der CPPC wo soll da der unterschied
sein. Zumindest die 240er Version scheint in der gleichen weise
gelötet zu sein wie der 604e auf der CPPC.

Die schnelleren Version sind wohl auch BGA, was aber nichts macht. Das Board ist das gleiche. Rund um den PPC sind die Lötpads für das CQFP Gehäuse. Man kann von dort aus messen. Schau dir mal die Fotos auf BBOAH an.

bye, ylf

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2005-10-18, 19:07 h

MaikG
Posts: 5172
User 		>An diese Möglichkeit habe ich auch schon gedacht.
>Jedoch ist nicht sichergestellt, das die Karte bei so
>extremer Untertakung auch läuft. Das muß man einfach
>probieren. Abgesehen davon habe ich mein Oszilloskop
>eh nicht hier. Sonst hätte ich das vielleicht schon
>probiert.

Ich hatte den CPPC PPC-Bustakt von 66 MHZ auf 50 MHZ reduziert,
war kein Problem.


>Es geht konkret um die Signale CSE0 und CSE1 vom 603e,
>die beim MPC745 nicht vorhanden sind. Sind Ausgänge,
>werden für ein externes Cacheinterface benötigt,
>der MPC750/755 hat dies bereits integriert und deshalb
>ein 360pin Gehäuse) können also offen bleiben.

Also ich hab da 10 Signale gezählt, da du immer vom
745er spichts hab ich mir das Datenblatt auch besorgt.
Der 745er ist identisch mit dem 740er, ausser das er
wohl nur 2 I/O Spannungen statt 3 kann.

>Die schnelleren Version sind wohl auch BGA, was aber nichts macht.
>Das Board ist das gleiche. Rund um den PPC sind die Lötpads für
>das CQFP Gehäuse. Man kann von dort aus messen. Schau dir mal die
>Fotos auf BBOAH an.

Der Vorteil deiner Version ist das den Prozi fast jeder "runternehmen"
kann ohne das eine gefahr für die BPPC besteht.

[ - Answer - Quote - Direct link - ]
2005-10-18, 19:11 h

GMB
Posts: 836
User
Zitat:
Original von ylf:
1. die absolut sichere mit einem Oszilloskop (100MHz, ich habe nur ein 20MHz).

Hi ylf,

vielleicht bekomme ich es ja gebacken, sowohl eine meiner PPCs (im eingebauten Zustand) als auch mein HP-Oszi in einem Raum zu vereinen.

Ciao

GMB

:boing: :dance1:

[ - Answer - Quote - Direct link - ]
2005-10-18, 19:18 h

ylf
Posts: 4112
User
Zitat:
Original von GMB:
Zitat:
Original von ylf:
1. die absolut sichere mit einem Oszilloskop (100MHz, ich habe nur ein 20MHz).

Hi ylf,

vielleicht bekomme ich es ja gebacken, sowohl eine meiner PPCs (im eingebauten Zustand) als auch mein HP-Oszi in einem Raum zu vereinen.

Ciao

GMB

:boing: :dance1:

Na denn los.
:D

bye, ylf

[ - Answer - Quote - Direct link - ]
2005-10-18, 19:23 h

ylf
Posts: 4112
User
Zitat:
Original von MaikG:
>An diese Möglichkeit habe ich auch schon gedacht.
>Jedoch ist nicht sichergestellt, das die Karte bei so
>extremer Untertakung auch läuft. Das muß man einfach
>probieren. Abgesehen davon habe ich mein Oszilloskop
>eh nicht hier. Sonst hätte ich das vielleicht schon
>probiert.

Ich hatte den CPPC PPC-Bustakt von 66 MHZ auf 50 MHZ reduziert,
war kein Problem.
50MHz ist noch im Rahmen, 20MHz sicherlich nicht.
Aber GMB kann die nötigen Messungen offensichtlich vornehmen. ;)

Zitat:
>Es geht konkret um die Signale CSE0 und CSE1 vom 603e,
>die beim MPC745 nicht vorhanden sind. Sind Ausgänge,
>werden für ein externes Cacheinterface benötigt,
>der MPC750/755 hat dies bereits integriert und deshalb
>ein 360pin Gehäuse) können also offen bleiben.

Also ich hab da 10 Signale gezählt, da du immer vom
745er spichts hab ich mir das Datenblatt auch besorgt.
Der 745er ist identisch mit dem 740er, ausser das er
wohl nur 2 I/O Spannungen statt 3 kann.
Kannst du mal aufzählen, welche Signale dies sind, vielleicht habe ich ja etwas übersehen.


Zitat:
>Die schnelleren Version sind wohl auch BGA, was aber nichts macht.
>Das Board ist das gleiche. Rund um den PPC sind die Lötpads für
>das CQFP Gehäuse. Man kann von dort aus messen. Schau dir mal die
>Fotos auf BBOAH an.

Der Vorteil deiner Version ist das den Prozi fast jeder "runternehmen"
kann ohne das eine gefahr für die BPPC besteht.

Und man kann ihn auch wieder drauflöten, falls es gar nicht anders geht.


bye, ylf

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2005-10-18, 23:22 h

MaikG
Posts: 5172
User 		>Kannst du mal aufzählen, welche Signale dies sind,
>vielleicht habe ich ja etwas übersehen.

Hab ich eigentlich hier irgendwo schon, wird langsam
unübersichtlich hier.
APE (740 NC)
CSE[0-1] (740 NC)
DRVMOD0³ (740 NC)
DRVMOD1³ (740 NC)
HALTED (740 NC)
L2_INT (740 NC)
SHD (Bei 740 IO Spannung)
TC[0-2] (740 NC)
TSIZ[0-2] (Bei 740 Output bei 604e I/O)
XATS (740 NC)

Zwar sind viele davon beim 74x NC, es könnte aber sein
das die B/CPPC diese Signale von der CPU benötigt. Man
müsste diese also mit einen durchgangsprüfer gegen
verschiedene Punkte Messen wahrscheinlich auf einer
Karte ohne PPC-Prozessor drauf, da der selbst die werte verfälschen kann.
Im falle einer CPPC währe eine MK3 bestens dafür geeignet.


>Und man kann ihn auch wieder drauflöten, falls es gar
>nicht anders geht.

Nich bei den entfehrnen an das ich gedacht habe...

[ - Answer - Quote - Direct link - ]
2005-10-19, 22:20 h

ylf
Posts: 4112
User 		APE (740 NC) --> Blizzard NC (habe ich übersehen)
DPE --> Blizzard NC (haben wir übersehen)
CSE[0-1] (740 NC) --> Blizzard NC
DRVMOD0³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?
DRVMOD1³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?
HALTED (740 NC) --> gibt es beim 603e nicht, welcher Pin?
L2_INT (740 NC) --> gibt es beim 603e nicht, welcher Pin?
SHD (Bei 740 IO Spannung) --> habe ich beim 603e ebenfalls nicht gefunden.
TC[0-2] (740 NC) --> Blizzard NC
TSIZ[0-2] (Bei 740 Output bei 604e I/O) Hm, werden auf der Blizzard verwendet, könnte vielleicht zum Problem werden.
XATS (740 NC) --> ist ein 604e Signal, entspricht beim 603e dem CSE1 und ist Blizzard NC


Zitat:
Zwar sind viele davon beim 74x NC, es könnte aber sein
das die B/CPPC diese Signale von der CPU benötigt. Man
müsste diese also mit einen durchgangsprüfer gegen
verschiedene Punkte Messen wahrscheinlich auf einer
Karte ohne PPC-Prozessor drauf, da der selbst die werte verfälschen kann.
Im falle einer CPPC währe eine MK3 bestens dafür geeignet.
Habe schon eine zuverlässigere Methode gefunden. ;)

Zitat:
>Und man kann ihn auch wieder drauflöten, falls es gar
>nicht anders geht.

Nich bei den entfehrnen an das ich gedacht habe...

Das habe ich schon befürchtet. Stümper! :D
Übrigens, so gesehen bekäme man ein BGA auch herunter.

bye, ylf

[ Dieser Beitrag wurde von ylf am 19.10.2005 um 22:25 Uhr editiert. ]

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2005-10-19, 23:30 h

MaikG
Posts: 5172
User 		>DRVMOD0³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?
>DRVMOD1³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?

D05 und C03 Für Normalbetrieb müssten die auf High.

>HALTED (740 NC) --> gibt es beim 603e nicht, welcher Pin?

B08

>L2_INT (740 NC) --> gibt es beim 603e nicht, welcher Pin?

D06

>SHD (Bei 740 IO Spannung) --> habe ich beim 603e ebenfalls nicht gefunden.

H04


>Habe schon eine zuverlässigere Methode gefunden. ;)

Welche? Da die Pins ja im Prozessor an irgendwas hängen
muss es ja zwangsläufig einen Wert geben.

>Das habe ich schon befürchtet. Stümper! :D
>Übrigens, so gesehen bekäme man ein BGA auch herunter.

Du sagst mit Heissluft kann die Platine kaputt gehen,
SMD-Lötkolben gibts meines wissens nur für Bauteile mit 2
Seiten voll beinchen. Man könnte höchstens jedes Hochbiegen.

[ - Answer - Quote - Direct link - ]
2005-10-20, 15:15 h

MaikG
Posts: 5172
User 		Ich hab mal kurz die äusseren pins auf der CPPC gemessen.
15 von 20 Pins konnte ich schnell auf die 543er
(unter der 3.Ram Bank und über der 4.Ram Bank) verfolgen.
Sprich diese Pins sind mit den 543er direkt verbunden.
Ist die wahrscheinlichkeit jetzt hoch das der 604e
über 3,3 Volt IO läuft?

Ich denke die 2 Wiederstände beim Spannungsregler habe
ich auch Lokalisiert, sind 1002er Wiederstände also
10k Ohm, einer zur Masse einer zu + vom Ausgang.

[ - Answer - Quote - Direct link - ]
2005-10-20, 17:34 h

ylf
Posts: 4112
User
Zitat:
Original von MaikG:
>DRVMOD0³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?
>DRVMOD1³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?

D05 und C03 Für Normalbetrieb müssten die auf High.
Ist beim 603e NC

Zitat:
>HALTED (740 NC) --> gibt es beim 603e nicht, welcher Pin?
B08
Ist beim 603e NC

Zitat:
>L2_INT (740 NC) --> gibt es beim 603e nicht, welcher Pin?
D06
Ist beim 603e NC

Zitat:
>SHD (Bei 740 IO Spannung) --> habe ich beim 603e ebenfalls nicht gefunden.
H04
Ist beim 603e NC

Scheint so, als hätte die Blizzard bessere Chancen auf einen MPC745.


Zitat:
>Habe schon eine zuverlässigere Methode gefunden. ;)

Welche? Da die Pins ja im Prozessor an irgendwas hängen
muss es ja zwangsläufig einen Wert geben.

Auf dem Bild von BBOAH ist bei der plus Version der Blizzard der Kühlkörper runter und ein BGA 603e drauf. Man kann auf dem Bild die Pads für das CQFP Gehäuse bestens sehen und eben auch, ob eine Leiterbahn weggeht. Für Durchkontaktierungen sind die Pads zu schmal.

Zitat:
>Das habe ich schon befürchtet. Stümper! :D
>Übrigens, so gesehen bekäme man ein BGA auch herunter.

Du sagst mit Heissluft kann die Platine kaputt gehen,
SMD-Lötkolben gibts meines wissens nur für Bauteile mit 2
Seiten voll beinchen. Man könnte höchstens jedes Hochbiegen.

Nein, es gibt auch spezielle Lötspitzen für andere Bauformen.
Da diese aber zu teuer und umständlich sind, geht man das Risiko mit Heißgas ein. Lötmaschinen verwenden sogar teilweise zum Bauteil passende Düsen, die die Wärme nur auf die Beinchen leiten.
Da gibt es eine ganze Menge an verschiedenen Werkzeugen.
Normalerweise ist es ja auch so, daß in einem Reparaturbetrieb alle nötigen Ersatzteile vorhanden sind und zur Not tauscht man das komplette Board aus.
Nur im Amiga Bereich kann man so nicht verfahren, weil die Hardware ja schon fast Einzelanfertigung ist.

bye, ylf

[ - Answer - Quote - Direct link - ]
2005-10-20, 18:59 h

MaikG
Posts: 5172
User 		>> Original von MaikG:
>> >DRVMOD0³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?
>> >DRVMOD1³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?

>> D05 und C03 Für Normalbetrieb müssten die auf High.
>Ist beim 603e NC

Die musst du auf High setzen, wenn der innere BGA bereich
nicht 1:1 mit dem äusseren verbunden ist, dürfte das
ein problem sein.

>Scheint so, als hätte die Blizzard bessere Chancen auf
>einen MPC745.

Wie kommst du darauf? Was bei der Blizzard NC ist kann
bei der CPPC auch gut NC sein.


>Auf dem Bild von BBOAH ist bei der plus Version der
>Blizzard der Kühlkörper runter und ein BGA 603e
>drauf. Man kann auf dem Bild die Pads für das CQFP
>Gehäuse bestens sehen und eben auch, ob eine
>Leiterbahn weggeht. Für Durchkontaktierungen
>sind die Pads zu schmal.

Ja, gut da muss man dann die Pins ins "Schachmuster" umsetzten.
Ich muss mal gucken ob es eine MK3 hochauflösend dort gibt.

[ - Answer - Quote - Direct link - ]
2005-10-20, 19:11 h

ylf
Posts: 4112
User
Zitat:
Original von MaikG:
>> Original von MaikG:
>> >DRVMOD0³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?
>> >DRVMOD1³ (740 NC) --> gibt es beim 603e nicht, welcher Pin?

>> D05 und C03 Für Normalbetrieb müssten die auf High.
>Ist beim 603e NC

Die musst du auf High setzen, wenn der innere BGA bereich
nicht 1:1 mit dem äusseren verbunden ist, dürfte das
ein problem sein.
Ich glaube da reden wir gerade aneinander vorbei.
Das sind 604 Signale, die es beim 603 schon nicht gibt und beim MPC745 auch nicht.
Wenn du einen 604 auf der Blizzard einsetzen willst, dann ja. Dann wird es zu einem Problem.
Für den MPC745 spielt es aber keine Rolle.

Zitat:
>Scheint so, als hätte die Blizzard bessere Chancen auf
>einen MPC745.

Wie kommst du darauf? Was bei der Blizzard NC ist kann
bei der CPPC auch gut NC sein.
Weil es größere Unterschiede in der Pinbelegung zwischen 604 und 745 gibt, als zwischen 603 und 745. Heit aber noch nicht, das es nicht geht.


Zitat:
>Auf dem Bild von BBOAH ist bei der plus Version der
>Blizzard der Kühlkörper runter und ein BGA 603e
>drauf. Man kann auf dem Bild die Pads für das CQFP
>Gehäuse bestens sehen und eben auch, ob eine
>Leiterbahn weggeht. Für Durchkontaktierungen
>sind die Pads zu schmal.

Ja, gut da muss man dann die Pins ins "Schachmuster" umsetzten.
Ich muss mal gucken ob es eine MK3 hochauflösend dort gibt.

Gucken kannst du mal, jedoch müssen die VIAs beim BGA im Pad sein, was man wahrscheinlich nicht erkennen kann.

bye, ylf

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2005-10-20, 23:19 h

MaikG
Posts: 5172
User 		>Ich glaube da reden wir gerade aneinander vorbei.
>Das sind 604 Signale, die es beim 603 schon nicht gibt
>und beim MPC745 auch nicht.

Achso, das 603er hab ich mir jetzt nicht angeguckt. Aber wie
gesagt was nützt ein 1GHZ Prozessor wenn die Festplatte nur
auf 10MB/s fahren kann?

>Weil es größere Unterschiede in der Pinbelegung zwischen 604 und
>745 gibt, als zwischen 603 und 745. Heit aber noch nicht, das es
>nicht geht.

Also bei der MK3 kann man halbwegs sehen welche Pins durchlocht
sind und welche nicht. Fast alle Pins währen danach angeschlossen.
Ich glaube jedoch nicht das es wirklich so ist.
z.B. ist TC[0-2] A02 und A03 nicht verbunden C06 führt jedoch zu
einer durchlochung. Bei TT[0-4) ist B16 und C15 NC.
Auf der MK3 fehlen auch 8 von diesen 543ern.

>Gucken kannst du mal, jedoch müssen die VIAs beim
>BGA im Pad sein, was man wahrscheinlich nicht erkennen kann.

VIA's? Du meinst durchlochungen? Die sind neben den Lötstellen.

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2005-10-21, 18:06 h

ylf
Posts: 4112
User
Zitat:
Original von MaikG:
>Ich glaube da reden wir gerade aneinander vorbei.
>Das sind 604 Signale, die es beim 603 schon nicht gibt
>und beim MPC745 auch nicht.

Achso, das 603er hab ich mir jetzt nicht angeguckt.

Macht ja nichts, ist halt Arbeitsteilung.


Zitat:
Aber wie
gesagt was nützt ein 1GHZ Prozessor wenn die Festplatte nur
auf 10MB/s fahren kann?

Wie kommst du auf 10MB/S und 1GHz. Am interenen IDE komme ich nur auf ca. 1,5MB (68040er), wenn ich mich recht erinnere und den MPC745 habe ich bislang nur bis 400MHz gesehen.
Aber stimmt schon, die Performence wird nicht optimal sein.
Deshalb ja mein Reden, ein G4 (oder G3) macht nur in Verbindung mit einem komplett neuen Mainboard Sinn, Turbokarte alleine reicht nicht.


[qutoe]
>Weil es größere Unterschiede in der Pinbelegung zwischen 604 und
>745 gibt, als zwischen 603 und 745. Heit aber noch nicht, das es
>nicht geht.

Also bei der MK3 kann man halbwegs sehen welche Pins durchlocht
sind und welche nicht. Fast alle Pins währen danach angeschlossen.
Ich glaube jedoch nicht das es wirklich so ist.
z.B. ist TC[0-2] A02 und A03 nicht verbunden C06 führt jedoch zu
einer durchlochung. Bei TT[0-4) ist B16 und C15 NC.
Auf der MK3 fehlen auch 8 von diesen 543ern.

>Gucken kannst du mal, jedoch müssen die VIAs beim
>BGA im Pad sein, was man wahrscheinlich nicht erkennen kann.

VIA's? Du meinst durchlochungen? Die sind neben den Lötstellen.

[/quote]

VIA (englisch) = Durchkontaktierung (deutsch)
Durchlochung = Bohrung?

bye, ylf

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2005-10-21, 18:58 h

MaikG
Posts: 5172
User 		>Wie kommst du auf 10MB/S und 1GHz. Am interenen IDE
>komme ich nur auf ca. 1,5MB (68040er), wenn ich mich
>recht erinnere und den MPC745 habe ich bislang nur
>bis 400MHz gesehen.

10 MB/s bringt der SCSI-Controller der Blizzard PPC,
wenn ich eine DVD von SCSI zu IDE brennen will,
bin ich entäuscht das ich eine Stunde darauf warten muss.
Beim A4000 bringt der Standart Interne IDE schon 3 MB/s
und der SCSI-Controller der CPPC 40 MB/s. Mit der CPPC
laufen auch die Acard's vernünftig dann währe mein
DVD-Brenner auch am SCSI-Controller mit einen super speed-
1GHZ war nur sinnbildlich gemeint.
Wie man mit 1,5 MB/s auskommen kann weiss ich nicht, damit ist grade 6x CD-Brennen
von Festplatte möglich.

>Aber stimmt schon, die Performence wird nicht optimal sein.
>Deshalb ja mein Reden, ein G4 (oder G3) macht nur in
>Verbindung mit einem komplett neuen Mainboard Sinn,
>Turbokarte alleine reicht nicht.

Ein neues Kompatibles Mainboard macht nun leider keiner.
Bei einer neuen CPPC mit G3/G4 währe ich dabei, so bleibt
normalerweise die Kompatiblität erhalten. Nur das Projekt
hier ist etwas wahrscheinlich einfacher und schneller
durchzuführen.


>VIA (englisch) = Durchkontaktierung (deutsch)
>Durchlochung = Bohrung?

Genau die sind neben den Lötstellen vom 604e, ich denke
das war mehr eine Optische entscheidung alle Durch zu kontaktieren.


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2005-10-21, 20:55 h

ylf
Posts: 4112
User
Zitat:
Original von MaikG:
Die man mit 1,5 MB/s auskommen kann weiss ich nicht, damit ist grade 6x CD-Brennen
von Festplatte möglich.
Für's AmigaOS reicht's, MorphOS läuft auch ordentlich, wobei ich davon ausgehe, daß unter MOS die Übertragung höher ist, weil beim interenen IDE der Speed vom Prozessor abhängt.
Alles, was größere Datenvolumen bewegt mache ich eh auf dem PC oder Mac.


Zitat:
Ein neues Kompatibles Mainboard macht nun leider keiner.
Bei einer neuen CPPC mit G3/G4 währe ich dabei, so bleibt
normalerweise die Kompatiblität erhalten. Nur das Projekt
hier ist etwas wahrscheinlich einfacher und schneller
durchzuführen.
Oh bitte nicht wieder diese überflüsse Grundsatzdiskussion.
Pegasos/MorphOS oder AmigaOne/AOS4 sind kompatibel genung.

Es scheitert eher am Mangel an Software.

Zitat:
>VIA (englisch) = Durchkontaktierung (deutsch)
>Durchlochung = Bohrung?

Genau die sind neben den Lötstellen vom 604e, ich denke
das war mehr eine Optische entscheidung alle Durch zu kontaktieren.
Wohl kaum. Irgentwo muß der Kontakt enden. Durchkontaktieren kosten Geld. Man macht keine, wenn man sie nicht braucht. Schon gar nicht an einem NC Pin.

bye, ylf

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2005-10-21, 23:35 h

MaikG
Posts: 5172
User 		>Für's AmigaOS reicht's, MorphOS läuft auch ordentlich,
>wobei ich davon ausgehe, daß unter MOS die Übertragung
>höher ist, weil beim interenen IDE der Speed vom Prozessor
>abhängt.

Etwas, aktzeptable geschwindigkeit ist das dennoch nicht.

>Oh bitte nicht wieder diese überflüsse Grundsatzdiskussion.
>Pegasos/MorphOS oder AmigaOne/AOS4 sind kompatibel genung.

Ansichtssache.


>Wohl kaum. Irgentwo muß der Kontakt enden.
>Durchkontaktieren kosten Geld. Man macht keine,
>wenn man sie nicht braucht. Schon gar nicht an
>einem NC Pin.

Deswegen ist dann auch ein durchkontaktierung an L2_Int?
Bei TC0-2 sind nur 2/3 verbunden
Bei TT0-4 sinds nur 3/5

L2-Cache gibt es nicht und die anderen Signale gehören
denke ich mal zusammen.


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2005-11-03, 16:19 h

MaikG
Posts: 5172
User 		Gibts schon was neues?
Einer wollte doch mit dem Ozilloskop nach der Spannung
gucken.
Ich hab mal ein bisschen an den Ram Teil gemessen,
ich weiss jetzt 23 Signalwege Rams->Chip und die Verbindungen
unter den Rambänken.

Kann man die 4 nicht zu 2 zusammenfassen(2x64MB) indem man
die Adressen verbindet? Ausser A0, A1 und A11(NC) sind
alle Adressen an alle Ram-Bänke.

Die ersten Datenleitungen der 1.Bank gehen an den 1. 543er.
A0,A1 gehen an den 1. 2245er
RAS2,RAS3 gehen an den 3. 2245er

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2005-11-03, 18:16 h

ylf
Posts: 4112
User
Zitat:
Original von MaikG:
Gibts schon was neues?
Einer wollte doch mit dem Ozilloskop nach der Spannung
gucken.
Ja, GMB hatte aber bislang noch keine Zeit dafür.
Vielleicht bekomme ich am Wochenende mit meinem 20MHz Oszi etwas heraus.


Zitat:
Ich hab mal ein bisschen an den Ram Teil gemessen,
ich weiss jetzt 23 Signalwege Rams->Chip und die Verbindungen
unter den Rambänken.
Ich nehme an, an der Cyberstorm, oder?
Das ist wichtig, weil Blizzard und Cyberstorm grund verschieden sind.

Zitat:
Kann man die 4 nicht zu 2 zusammenfassen(2x64MB) indem man
die Adressen verbindet? Ausser A0, A1 und A11(NC) sind
alle Adressen an alle Ram-Bänke.
Keine Ahnung, habe mich mit dieser Thematik noch nicht im Detail beschäftigt.

Zitat:
Die ersten Datenleitungen der 1.Bank gehen an den 1. 543er.
A0,A1 gehen an den 1. 2245er
RAS2,RAS3 gehen an den 3. 2245er

Kannst ja mal einen Plan anfangen zu skizzieren.

bye, ylf

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2005-11-03, 18:46 h

MaikG
Posts: 5172
User 		>Ich nehme an, an der Cyberstorm, oder?

Jepp, da die CPPC nach wie vor bei mir nicht richtig will,
ist die BPPC immerzu in Betrieb, daher kann ich da nix
messen.


> quote:
> Die ersten Datenleitungen der 1.Bank gehen an den 1. 543er.
> A0,A1 gehen an den 1. 2245er
> RAS2,RAS3 gehen an den 3. 2245er
>
>Kannst ja mal einen Plan anfangen zu skizzieren.

Mit Zeichen ist da nicht viel, eine solche dichte bekommt
man nicht auf einem blatt unter. Ausserdem fehlen da noch
verbindungen im 3 stelligen bereich bevor eine Funktionstüchtige
CPPC draus wird. Und dann müsste man das noch in einem Layout
Programm bringen, dann währen da noch die Mach's und CV's die wo das
Programm fehlt.

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2005-11-03, 20:20 h

ylf
Posts: 4112
User 		@MaikG:
ich meinte da eher ein Blockschaltbild. Das genüng für den Anfang.

bye, ylf

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2005-11-05, 18:46 h

MaikG
Posts: 5172
User 		Ich habs dir per Email geschickt, hab noch kein Webspace,
kannst es hier reinstellen.

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2005-11-06, 17:44 h

ylf
Posts: 4112
User 		Bild: http://home.arcor.de/joerg__thomas/ext-gfx/CPPCConnections.png
Das ist doch schon mal was. So detailliert hätte ich das jetzt nicht erwartet. Wirklich weiterhelfen tut uns das im Augenblick zwar nicht, jedoch hilft es, Arbeit zu sparen, falls jemand an dieser Stelle weiter machen will.

Ich war am Wochenende auch nicht untätig, allerdings mit weniger Erfolg. Mit 25MHz startet die Blizzard nicht. Also nichts mit Untertakten und dann messen. Auch wird das Messen etwas aufwendig, weil ich dazu meinen Amiga fast komplett zerlegen muß und freiliegen auf einen Tisch wieder zusammensetzen muß. Das braucht etwas mehr Zeit.

bye, ylf

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2005-11-06, 18:38 h

MaikG
Posts: 5172
User 		>Das ist doch schon mal was. So detailliert hätte ich das
>jetzt nicht erwartet.

Mit Blockschaltbild konnte ich nicht viel anfangen,
aber da es kein Layout sein musste das ich mit meinem
drucker fabrizieren kann(geht nur mit viel dickeren Bahnen),
hab ich das gemacht.

>Wirklich weiterhelfen tut uns das
>im Augenblick zwar nicht, jedoch hilft es, Arbeit zu
>sparen, falls jemand an dieser Stelle weiter machen will.

Evtl. hilft das meine CPPC stabiel zu machen.
Falls jemand die CPPC redesignt sind das schon so 3% oder so :-)
Durch messen kommt wahrscheinlich jedoch kein vollständiger Plan
zustande, an der 604e kann man nicht messen und das war auch
nur von A nach B, wenn eine Leitung jetzt z.B. nach C geht fehlt
da was.

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